רובוט
היי א אי
stars

תגידו שלום לתפקיד הבא שלכם

לראשונה בישראל:
המלצות מבוססות AI שישפרו
את הסיכוי שלך למצוא עבודה

מהנדס וריפיקציה | ולידציה

מסמך
מילות מפתח בקורות חיים
סימן שאלה
שאלות הכנה לראיון עבודה
עדכון משתמש
מבחני קבלה לתפקיד
שרת
שכר
משרות על המפה
 
בדיקת קורות חיים
VIP
הפוך ללקוח VIP
רגע, משהו חסר!
נשאר לך להשלים רק עוד פרט אחד:
 
שירות זה פתוח ללקוחות VIP בלבד
AllJObs VIP

חברות מובילות
כל המידע למציאת עבודה
להשיב נכון: "ספר לי על עצמך"
שימו בכיס וצאו לראיון: התשובה המושלמת לשאלה שמצ...
קרא עוד >
לימודים
עומדים לרשותכם
מיין לפי: מיין לפי:
הכי חדש
הכי מתאים
הכי קרוב
טוען
סגור
לפי איזה ישוב תרצה שנמיין את התוצאות?
Geo Location Icon

משרות בלוח החם
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 14 שעות
ביופרמקס גרופ 1996 בע"מ
דרושים בביופרמקס גרופ 1996 בע"מ
מיקום המשרה: הרצליה
סוג משרה: משרה מלאה
לחברת תכנון והנדסה מובילה המתמחה בתכנון, בנייה ושדרוג של מפעלי תרופות דרוש/ה מהנדס/ת ולידציה בעל/ת תשוקה למצוינות ודיוק!
תכנון והובלת תהליכי ולידציה למערכות ומכשור בתחום הפארמה.
- ביצוע בדיקות תפקודיות והסמכת מערכות בהתאם לדרישות רגולטוריות.
- כתיבת דוחות ולידציה מפורטים ותיעוד תהליכים.
- שיתוף פעולה עם צוותי הפיתוח, הייצור והאיכות.
דרישות:
הבנה בתהליכי ולידציה ורגולציה בתחום הפארמה (כגון GMP).
- ניסיון בעבודה עם מערכות מכשור ומחשוב יתרון.
3 שנות ניסיון חובה
- אנגלית ברמה גבוהה חובה.

**תכונות אישיות:**
- יכולת עבודה עצמאית ובצוות.
- תשומת לב לפרטים ויכולת ניהול זמן מעולה.
- יחסי אנוש טובים וחשיבה אנליטית. המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8122404
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 
משרה בלעדית
לפני 19 שעות
דקסל פארמה
דרושים בדקסל פארמה
מיקום המשרה: אור עקיבא
סוג משרה: משרה מלאה
אם את/ה מחפש/ת את האתגר הבא שלך, אנחנו מחפשים אותך! למחלקת ההנדסה שלנו דרוש/ה מהנדס/ת וולידציה

איך אומרים בשלוש מילים למה כדאי לעבוד בדקסל?
סיפור הצלחה ישראלי!

האחריות שלך תכלול כתיבה ואישור של פרוטוקולי וולידציה למערכות חדשות וקיימות, ביצוע פרוטוקולי וולידציה בהתאם ל GDP ונהלים, עדכון תכניות וולידציה.
ביצוע סקרי סיכונים ומעקב ובקרה אחרי סקירות שנתיות לציוד.
בנוסף, תעבוד/י מול צוותים שונים ויהיה לך קשר ישיר עם ספקי ציוד ותיתנ/י מענה לביקורות פנימיות וחיצוניות - כל זה באנגלית!

אנחנו מזמינים אותך להשתלב בחברת הפארמה הפרטית הגדולה בישראל, עם רבי מכר כמו דקסמול, אומפרדקס, קומבודקס ועוד הרבה תרופות אחרות שמגיעות למעל מאה חמישים מיליון אנשים!
דרישות:
תוכל/י להיות חלק מהצוות במידה ויש לך:
תואר ראשון כמהנדס/ת כימיה או מכונות
ניסיון של שנתיים לפחות בתחום הוולידציה בחברת פארמה/מדיקל דיוויס/מזון/ביוטכנולוגיה/קנאביס
אופיס ברמה גבוהה
אנגלית ברמה גבוהה מאוד

אם את/ה מוכן/ה לאתגר הבא, הצטרף/י אלינו וצמח/י איתנו!
לשליחת קורות חיים> המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8036111
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 
משרה בלעדית
לפני 19 שעות
דיאלוג
דרושים בדיאלוג
מיקום המשרה: מספר מקומות
סוג משרה: משרה מלאה
לחברה גלובלית ותיקה העוסקת בפיתוח וייצור של רכיבים זעירים עבור תעשיית המכשור הרפואי, דרוש/ה Process Validation engineer.
מתעסקים בעיקר בעיבוד, חיתוך, קידוח וריתוך בלייזר.
במסגרת התפקיד, אחריות על תכנון, תיאום וביצוע פעילויות ולידציה, במטרה להבטיח שתהליכי הייצור מייצרים באופן עקבי מוצרים העומדים בתקני איכות מוגדרים מראש. תפקיד זה כולל פיתוח פרוטוקולי ולידציה, ניתוח נתונים והכנת דוחות מקיפים בהתאם לדרישות רגולטוריות ואיכות (כגון FDA, ISO 13485).
יושבים באזור השרון
דרישות:
2-5 שנות ניסיון ב-NPI ובוולידציה בתעשיית המכשור הרפואי או התרופות
ידע חזק בעקרונות ולידציה ותקנים רגולטוריים (כגון 21 CFR Part 820, ISO 13485)
ניסיון עם כלים וסטטיסטיקה תוכנתית (כגון Minitab) יתרון
אנגלית ברמה גבוהה
תואר ראשון בהנדסה (מכונות, ביו-רפואה, כימיה או תחום רלוונטי אחר)
תואר שני יתרון המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8251071
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
Experis Software
מיקום המשרה: תל אביב יפו
אנחנו מחפשים Digital Verification engineer לחברה גלובלית ענקית היושבת בתל אביב.

הצטרפו לצוות חדשני המפתח פתרונות פורצי דרך לתחום המערכות מולטי-מצלמה וחיישנים. אנו מחפשים מהנדסים מוכשרים המוכנים להתמודד עם אתגרים טכניים מורכבים ולקדם פריצות דרך טכנולוגיות.

במסגרת התפקיד:
אחריות על מחזור חיים מלא של הוריפיקציה - החל משלב התכנון ועד ביצוע בדיקות, איסוף וסגירת כיסוי.
תכנון האימות של בלוקים דיגיטליים מורכבים, המכילים מעבדים משובצים, על ידי הבנה מלאה של מפרט התכנון ואינטראקציה עם מהנדסי תכנון ותוכנה לזיהוי תרחישי אימות חשובים.
בניית סביבת אימות אוטומטית מבוססת Constrained-Random בשפת SystemVerilog, תוכניות C / C ++ ושפות סקריפט.
זיהוי וכתיבת כל סוגי מדדי הכיסוי עבור גירויים ומקרי קצה.
איתור תקלות (Debug) מול מהנדסי תכנון.
שיתוף פעולה הדוק עם מהנדסי תכנון ואימות בפרויקטים פעילים וביצוע אימות מעשי.
סגירת מדדי כיסוי לזיהוי חורים באימות והתקדמות לקראת tape-out.
דרישות:
תואר ראשון בהנדסת אלקטרוניקה
לפחות שנה ניסיון בתור מהנדס/ת אימות
ידע במתודולוגיות אימות, כלים וטכניקות (סימולציות, כיסוי, Assertions, Formal ועוד)
ידע רחב בשפות SystemVerilog ו-Verilog
שליטה בסביבת Unix ושפות סקריפט: Python, Tcl, C Shell, PERL
ידע בסיסי בתכנות C / C ++
גישה מתודולוגית לבניית סביבת אימות ותכניות בדיקה
גישה מתודולוגית לתכנון וביצוע משימות אימות
יכולת עבודה בצוות
יתרון: ניסיון באימות של מעבדים משובצים ( Embedded Processor Verification) המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8135308
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
1 ימים
אלביט מערכות
דרושים באלביט מערכות
Job Type: Full Time
We are seeking a highly skilled Verification engineer and Logic Designer to join our dynamic team.

Key Responsibilities:
Develop and implement comprehensive verification plans for logic designs
Design and maintain testbenches for logic projects
Conduct functional simulations and analyze results to ensure design integrity
Debug and resolve issues identified during verification
Collaborate closely with design engineers to understand design intent and constraints
Design and develop logic-based solutions using VHDL/Verilog
Requirements:
Requirements:
At least 4 years of hands-on experience in verification and logic design
Bachelor's or Master's degree in Electrical Engineering, Computer Engineering, or a related field
Proven experience with VHDL logic design principles, including timing, area, and power implications
Experience in creating complex designs, including coding and integrating third-party Ips
Strong background in synthesis, place and route, and timing compliance
Proficiency in lab logic debugging methodologies such as ChipScope/SignalTap
This position is open to all candidates.
 
Show more...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8186153
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 
משרה בלעדית
1 ימים
Experis Software
דרושים בExperis Software
מיקום המשרה: תל אביב יפו
דרוש/ה מהנדס/ת אימות קושחה (Firmware Verification engineer )
לתפקיד מרתק בחברה גלובלית מובילה בתל אביב, העוסקת בפיתוח חיישני תמונה חדשניים למצלמות של סמארטפונים מהשורה הראשונה.

מה בתפקיד?
ביצוע ולידציה מעמיקה לקושחה ולמערכות משולבות חומרה - תוכנה
פיתוח והרצה של תכניות בדיקה ואוטומציה ב- Python
עבודה צמודה עם מהנדסי FW ואלגוריתמים לזיהוי ופתרון באגים
פיתוח תשתיות בדיקה על גבי סימולטורים/אימולטורים (Palladium, FPGA)
דרישות:
לפחות 2 שנות ניסיון בתחום הוריפיקציה/בדיקות לקושחה או מערכות Embedded.
ניסיון בפיתוח אוטומציה ב- Python
תואר ראשון בהנדסת חשמל/ מדמ"ח /תחום רלוונטי
ידע ב- C חובה
יכולת למידה מהירה ומוטיבציה גבוהה המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8241474
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
3 ימים
אומגה - Omega Israel
דרושים באומגה - Omega Israel
מיקום המשרה: תל אביב יפו
דרוש/ה מהנדס/ת וריפקציה בכיר המנוסה בסביבות(UVM (Universal Verification Methodology SystemVerilogai.
היחידה מציעים הזדמנות להשתלב בארגון דינמי, עם אפשרויות קידום והתפתחות מקצועית.
הצטרפות לצוות שלנו משמעותה עבודה בסביבה מאתגרת וטכנולוגית עם דגש על פיתוח ועול מתמידים.
היחידה מחפשים מהנדס וריפקציה בכירים מנוסים ומוכשרים שיצטרפו לצוות ההנדסה והפיתוח שלנו ויובילו בתחום הווריפקציה. בתפקיד זה אחראים על איתור ופתרון אתגרים טכנולוגים, ניהול ציר והכוונה של ציר הוריפיקציה בפרויקטים חדשניים, שיפור ופיתוח מתודולוגיות עבודה לתחום, חניכה וליווי של מהנדסים מוכשרים.
דרישות:
בעל תואר אקדמי ראשון או הנדסה בתחוםהמדעים המדויקים.(עדיפות לתואר ראשון בהנדסת חשמל או במדעי המחשב)
בעל ניסיון של 3 שנים לפחות בתכן VLI או FPGA ובסימולציות של צ'יפים.
בעל ניסיון של שנתיים לפחות בניהול צוות או הובלת פרו?יק?ט.
ניסיון בתחום ווריפקציה עם UVM - לפחות 7 שנות ניסיון.

המשרה מיועדת לנשים וגברים כאחד המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8097777
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
 
משרה בלעדית
3 ימים
לוגיקה IT
דרושים בלוגיקה IT
תנאים נוספים: מספר סוגים
לחברת Medical גלובלית מבוססת ומצליחה אשר משרדיה ממוקמים באזור הצפון, דרוש/ה Quality Engineer.
היקף המשרה: משרה מלאה וקבועה (9 שעות מדי יום).  
מיקום המשרה: יוקנעם עילית, מחוז צפון.
היברידיות: 2 ימים מהבית | 3 ימים מהמשרדים.
דרישות:
השכלה אקדמאית בהנדסה או ניהול איכות או תחום לימודים אחר דומה חובה.
3 שנות ניסיון ומעלה בתפקיד של Quality Engineer מחברת Medical או Pharmaceutics  חובה.
ניסיון תעסוקתי מוכח בניהול תהליכים עם CAPA (Corrective And Preventive Actions) חובה.
ניסיון תעסוקתי מוכח בהבטחת האיכות והעמידה בדרישות רגולציה של מכשור רפואי חובה.
ניסיון תעסוקתי מוכח עם תקן ISO 13485 או FDA חובה.  
ידע או ניסיון בטיפול בחריגות (NC) יתרון.
שליטה ברמה גבוהה בדיבור, כתיבה וקריאה בשפה האנגלית. המשרה מיועדת לנשים ולגברים כאחד.
 
עוד...
הגשת מועמדות
עדכון קורות החיים לפני שליחה
8239292
סגור
שירות זה פתוח ללקוחות VIP בלבד
לוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 14 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
we are looking for a Design Verification Engineer, CPU, Google Cloud
As a CPU Design Verification Engineer, you will work as part of a Research and Development team, and you will build verification components, constrained-random testing, system testing, and verification closure. As part of our server chip design team, you will verify digital designs. You will collaborate closely with design and verification engineers in projects and perform direct verification. You'll build efficient and effective constrained-random verification environments that exercise designs through their corner-cases and expose all types of bugs. You will manage the full lifecycle of verification which can range from verification planning, test execution or collecting, and closing coverage.

Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog/UVM, or Specman.
Identify and write all types of coverage measures for stimulus and corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Lead coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
3 years of experience verifying digital logic at RTL level using SystemVerilog, or Specman/E for FPGAs or ASICs.
Experience verifying digital systems using standard IP components/interconnects (microprocessor cores, hierarchical memory subsystems).
Experience creating and using verification components and environments in standard verification methodology.

Preferred qualifications:
Masters degree in Electrical Engineering, Computer Science, or related field.
Experience with UVM, SystemVerilog, or other scripting languages (e.g. Python, Perl, Shell, Bash, etc.).
Experience with CPU implementation, assembly language, or compute System on a Chip (SOC).
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8258041
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 14 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
we are looking for a Senior Formal Verification Engineer, Google Cloud
Responsibilities
Plan the formal verification strategy and create the properties and constraints for digital design blocks.
Utilize formal property verification tools combined with formal verification closure techniques to verify properties.
Resolve difficult to verify properties, and contribute improvements to methodologies to enhance formal verification results.
Architect and implement reusable formal verification components.
Requirements:
Bachelor's degree in Electrical Engineering, Computer Science, or equivalent practical experience.
8 years of experience working in main interconnects, Direct Memory Access (DMA), controllers, and power management.
Experience capturing design specification in a temporal assertion language (e.g., SVA or PSL).

Preferred qualifications:
Master's degree or PhD in Electrical Engineering or Computer Science, or a related technical field.
Experience with scripting languages (e.g., Python).
Experience working with one or more formal verification tools, such as JasperGold, VC Formal, Questa Formal, or 360-DV.
Knowledge of formal verification algorithms.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8258000
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 14 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
As a SERDES/PCIe Silicon Validation Engineer, you will take ownership on characterization of SERDES analog IPs provided by external vendors. Your job is to assure that the IP is meeting Google high standards. You will work closely with different multi-functional teams within the Silicon organization, as well as external vendors.

Responsibilities
Perform thorough Lab characterization/Validation of Serializer/Deserializer (SERDES) IPs, such as PCIeG6 PHYs.
Write Inhouse tools/scripts to characterize the IP.
Manage bench test, debug, and characterization of analog/mixed signal on-chip circuitry (PLLs, Clocks, Data Converters and various I/O Interfaces).
Manage the development of benchtop electrical tests exercising on-chip circuitry through a combination of Joint Test Action Group (JTAG), Universal Asynchronous Receiver/Transmitter (UART), Serial Peripheral Interface (SPI), and other analog interfaces.
Draft and execute scripts to automate tests, extract results, and generate reports using database and investigative tools.
Requirements:
Bachelor's degree in Electrical Engineering, Computer Engineering, Computer Science, a related field, or equivalent practical experience.
5 years of experience working with PLLs, PCIe, SerDes IPs.
Experience with lab automation software such as Python, and Matlab.
Experience with SerDes Debug.
Experience working with lab equipment such as Bidirectional Encoder Representations from Transformers (BERT), real-time scopes, Spectrum Analyzers, Vector Network Analyzers (VNA), or protocol analyzers.
Experience with board design and debugging.

Preferred qualifications:
Experience in PCIe compliance measurements using high-end equipment (e.g., Analyzer, Exerciser).
Experience in lab equipment for PCIe testing (physical or protocol level).
Knowledge of Tx/Rx equalization techniques and adaptation.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257888
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 14 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
As an Executive CPU Design Verification Engineer, you will be a part of Research and Development team to verify digital designs, develop constrained-randomn test environments and drive system testing to closure. You will collaborate with design and verification teams, manage the verification life-cycle and uncover bugs through rigorous corner-case testing.
Responsibilities
Plan and execute the verification of digital design blocks by understanding specifications and working with design engineers to define key verification scenarios.
Develop and refine random verification environments using SystemVerilog/UVM or Specman to ensure effective test coverage.
Define and implement various coverage measures to capture stimulus and corner-case scenarios.
Collaborate with design engineers to debug tests and ensure functional correctness of design blocks.
Drive coverage analysis to identify verification gaps and demonstrate progress towards tape-out.
Requirements:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
8 years of experience verifying digital logic at Register-Transfer Level (RTL) using SystemVerilog or Specman/E for Field Programmable Gate Arrays (FPGAs) or Application-specific integrated circuit (ASICs).
Experience with Central Processing Unit (CPU ) implementation, assembly language, or compute System on a Chip (SOC).
Experience verifying digital systems using standard IP components/interconnects (microprocessor cores, hierarchical memory subsystems).
Experience creating and using verification components and environments in standard verification methodology.

Preferred qualifications:
Masters degree in Electrical Engineering or Computer Science.
Experience with UVM, SystemVerilog, or other scripting languages (e.g., Python, Perl, Shell, Bash, etc.).
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257881
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 14 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
In this role, you will join a Peripheral Component Interconnect Express (PCIe) team and take ownership of post-silicon and pre-silicon validation efforts. You will ensure the Internet Protocol (IP) meets Google's standards while collaborating with cross-functional teams and external vendors.

Responsibilities
Lead or co-lead the PCIe sub system post-silicon logic validation process, including planning, methodology development and co-ordinating with emulation, firmware and testing teams.
Participate in both emulation and post-silicon validation phrases by designing, implementing and excuting tests and tools.
Drive the debugging and resolution of complex silicon issues, collaborating with cross-functional teams across design, architecture, software and firmware.
Analyze validation data to identify trends and root causes and to uncover opportunities for enhancing silicon quality, reliability and performance.
Requirements:
Bachelor's degree in Electronic Engineering or Computer Engineering, or equivalent practical experience.
3 years of experience in embedded C/C++ code development.
Experience with PCIe protocol like transaction, data link, PHY logical layers.
Experience in Physical Layer (PHY) design and development.

Preferred qualifications:
Experience in PCIe compliance measurements using high-end equipment (e.g., Analyzer, Exerciser).
Experience in lab equipment for PCIe testing including physical and protocol level.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257800
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 15 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
we are looking for a CPU Verification Technical Lead, Google Cloud
Responsibilities
Plan the verification strategy, identify the platform to validate reasoning components.
Define the test plan and strategy with stakeholders, including sign-off and exit criteria.
Plan and execute the verification of Internet Protocols (IPs) using dynamic verification and formal verification.
Requirements:
Bachelor's degree in Electrical Engineering, Computer Science, or equivalent practical experience.
Experience in managing Design Verification (DV) team.
Experience with verifying units using formal and design verification methodologies.
Experience in verification methodologies, tools, and techniques.
Experience in leading technical teams and building cross-functional relationships.

Preferred qualifications:
Master's degree or PhD in Electrical Engineering or Computer Science.
Experience in working with one or more formal verification tools (e.g., JasperGold, VC Formal, Questa Formal, 360-DV).
Experience with verification techniques, and full verification life cycle.
Experience in leading teams and delivering projects.
Excellent communication skills, with the ability to present technical concepts to audiences.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257797
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 15 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
we are looking for a SoC Verification Technical Lead, Google Cloud
Responsibilities
Plan the verification strategy, identify the platform to validate reasoning components.
Define the test plan and strategy with stakeholders, including sign-off and exit criteria.
Plan and execute the verification of Internet Protocols (IPs) using dynamic verification and formal verification.
Requirements:
Bachelor's degree in Electrical Engineering, Computer Science, or equivalent practical experience.
10 years of experience in managing Design Verification (DV) team.
Experience with verifying units using formal and design verification methodologies.
Experience in verification methodologies, tools, and techniques.
Experience in leading technical teams and building cross-functional relationships.

Preferred qualifications:
Master's degree or PhD in Electrical Engineering or Computer Science.
Experience in working with one or more formal verification tools (e.g., JasperGold, VC Formal, Questa Formal, 360-DV).
Experience with verification techniques, and full verification life-cycle.
Experience in leading teams and delivering projects.
Excellent communication skills, with the ability to present technical concepts to audiences.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257792
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 15 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
As a Senior SoC Design Verification Engineer, you will work as part of a Research and Development team. You will build verification components, constrained-random testing, system testing, and drive verification closure.
Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog and UVM, or formally verify designs with SVA and industry leading formal tools.
Identify and write all types of coverage measures for corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Close coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
8 years of experience with creating and using verification components and environments in standard verification methodology.
Experience verifying digital systems using standard IP components/interconnects (microprocessor cores, hierarchical memory subsystems).
Experience verifying digital logic at RTL level using SystemVerilog or Specman/E for FPGAs or ASICs.

Preferred qualifications:
Master's or PhD degree in Electrical Engineering.
Experience with verification techniques, and the full verification life cycle.
Experience with performance verification of ASICs and ASIC components.
Experience with ASIC standard interfaces and memory system architecture.
Experience in 4 or more SOC cycles.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257770
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 15 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
As a Senior CPU Design Verification Engineer, you will work as part of a Research and Development team, and you will build verification components, constrained-random testing, system testing, and verification closure. As part of our server chip design team, you will verify digital designs. You will collaborate with design and verification engineers in projects and perform direct verification. You will build constrained-random verification environments that exercise designs through their corner-cases and expose all types of bugs. You will manage the full life-cycle of verification which can range from verification planning, test execution or collecting, and closing coverage.The ML, Systems, & Cloud AI (MSCA) organization at Google designs, implements, and manages the hardware, software, machine learning, and systems infrastructure for all Google services (Search, YouTube, etc.) and Google Cloud. Our end users are Googlers, Cloud customers and the billions of people who use Google services around the world.
Responsibilities
Plan the verification of digital design blocks by understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog/Universal Verification Methodology (UVM), or Specman.
Identify and write all types of coverage measures for stimulus and corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Lead coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
8 years of experience verifying digital logic at RTL level using SystemVerilog or Specman/E for Field Programmable Gate Arrays (FPGAs) or ASICs.
Experience verifying digital systems using standard IP components/interconnects (microprocessor cores, hierarchical memory subsystems).
Experience creating and using verification components and environments in standard verification methodology.
Experience with CPU implementation, assembly language, or compute System on a Chip (SOC).

Preferred qualifications:
Masters degree in Electrical Engineering or Computer Science.
Experience with UVM, SystemVerilog, or other scripting languages (e.g., Python, Perl, Shell, Bash, etc.).
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257727
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 15 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
we are looking for a Formal Verification Engineer, Networking, Google Cloud
Responsibilities
Plan the formal verification strategy and create the properties and constraints for digital design blocks.
Utilize formal property verification tools combined with formal verification closure techniques to verify properties.
Contribute improvements to methodologies to enhance formal verification results.
Architect and implement reusable formal verification components.
Requirements:
Bachelor's degree in Electrical Engineering, Computer Science, or equivalent practical experience.
4 years of experience working in main interconnects, Direct Memory Access (DMA), controllers, and power management.
Experience capturing design specification in a temporal assertion language (e.g., System Verilog Assertions (SVA) or Property Specification Language (PSL)).

Preferred qualifications:
Master's degree or PhD in Electrical Engineering or Computer Science, or a related field.
Experience working with one or more formal verification tools (e.g., JasperGold, VC Formal, Questa Formal, or Display and Video 360).
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257723
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
לפני 15 שעות
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
In this role, you will work as part of a Research and Development team. You will build verification components, constrained-random testing, system testing, and verification closure. You will verify digital designs and collaborate with design and verification engineers in projects and perform direct verification. You will build efficient and effective constrained-random verification environments that exercise designs through their corner-cases and expose all types of bugs. You will manage the full life-cycle of verification which can range from verification planning, test execution or collecting, and closing coverage.

Responsibilities
Plan the verification of digital design blocks by understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog or formally verify designs with Strategic Value Add (SVA) and industry leading formal tools.
Identify and write all types of coverage measures for stimulus and corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Close coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Bachelor's degree in Electrical Engineering or equivalent practical experience.
4 years of experience working with design networking like Remote Direct Memory Access (RDMA) or packet processing and system design principles for low latency, throughput, security, and reliability.
Experience in creating and using verification components and environments in standard verification methodology.

Preferred qualifications:
Experience in verifying digital systems using standard Internet Protocol (IP) components or interconnects (e.g., microprocessor cores, hierarchical memory subsystems).
Experience in Transmission Control Protocol (TCP), IP, Ethernet, PCIE and Dynamic random-access memory (DRAM), Network on Chip (NoC) principles and protocols.
Experience in estimating performance by analysis, modeling, and network simulation in defining and driving performance test plans.
Experience with verification techniques, and the full verification life-cycle.
Experience with performance verification of ASICs and ASIC components.
Experience with ASIC standard interfaces and memory system architecture.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8257714
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
Location: Tel Aviv-Yafo and Haifa
Job Type: Full Time
As a Design Verification Engineer, you will work as part of a Research and Development team building verification components, constrained-random testing, system testing, and verification closure. As part of our server chip design team, you will verify digital designs. You will collaborate with design and verification engineers in active projects and perform verification. You will be responsible for the full life-cycle of verification which can range from verification planning, test execution or collecting and closing coverage.

Responsibilities
Plan the verification of digital design blocks by fully understanding the design specification and interacting with design engineers to identify important verification scenarios.
Create and enhance constrained-random verification environments using SystemVerilog or formally verify designs with SystemVerilog Assertions (SVA) and industry leading formal tools.
Identify and write all types of coverage measures for stimulus and corner-cases.
Debug tests with design engineers to deliver functionally correct design blocks.
Apply close coverage measures to identify verification holes and to show progress towards tape-out.
Requirements:
Bachelor's degree in Electrical Engineering, Computer Engineering, Computer Science, a related field, or equivalent practical experience.
1 year of experience creating and using verification components and environments in standard verification methodology.
Experience verifying digital logic at Register Transfer Level (RTL) level using SystemVerilog or Specman/E for Field Programmable Gate Arrays or ASICs.

Preferred qualifications:
Masters degree in Electrical Engineering, Computer Science, or a related field.
Experience with Universal Verification Methodology (UVM), SystemVerilog, or other scripting languages (e.g., Python, Perl, Shell, Bash, etc.).
Experience with CPU implementation, assembly language or compute SOCs.
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8255894
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
2 ימים
Location: Holon
abra R&D is seeking for an Integration and Verification Engineer. We are looking for a skilled Integration and Verification Engineer to perform functional testing, system integration, and field trials of complex multi-disciplinary systems including RF, hardware, firmware, and software. This role requires hands-on experience with lab equipment, strong troubleshooting capabilities, and the ability to lead field tests and provide technical support to customers. A full time on site position, based in Holon, Israel. ?Key Responsibilities:
* Perform integration and verification testing of systems and subsystems (HW/SW/FW/RF)
* Operate test equipment (e.g., Spectrum Analyzer, Signal Generator) and develop test automation scripts
* Lead field tests, including test setup design, documentation, and real-time troubleshooting
* Deliver technical demonstrations and training (OJT) to customers, both in Israel and abroad
Requirements:
* B.Sc. in Electrical Engineering / Practical Engineer (Electrical) with at least 3 years of relevant experience
* Proven experience in system-level testing and integration of RF, hardware, firmware, and software
* Hands-on experience with lab test equipment: Spectrum Analyzer, Signal Generator, Oscilloscope
* Ability to write test documentation and basic test scripts
* Willingness to travel abroad for field testing and customer support
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8194235
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
5 ימים
Location: Herzliya
Job Type: Full Time
Power the Future with us! At SolarEdge (NASDAQ: SEDG), we're a global leader in smart energy technology, with over 3,000 employees, offices in 34 countries, and millions of installations worldwide. Our innovative solutions include solar inverters, battery storage, backup systems, EV charging, and AI-based energy management. We're committed to making clean, green energy the primary power source for homes, businesses, and beyond. With the growing demand for electricity, the need for smart, clean energy sources is constantly rising. SolarEdge offers amazing opportunities to develop your skills in a multidisciplinary environment, covering everything from research and development to production and customer supply. Work with talented colleagues, tackle exciting challenges, and help create a sustainable future in an industry that's always evolving and innovating. Join us and be part of a company that values creativity, agility, and impactful work. We are looking for an ASIC Verification engineer with good good grasp of the entire verification process – plan, execution and sign-off, excellent analytical skills, technical skills and high motivation to join our team and take part of the success. What you will be doing:
* Create a thorough verification plan out of IP specification and implement it to completeness.
* Build UVM-compliant IP verification environment from scratch.
* Debug to find root cause of issues.
* Full-chip verification from planning stage to tape-out, including gate-level testing.
* Testing using both System Verilog and C.
* Work in a diverse environment, collaborating with power engineers, communication experts and SW developers.

Country:
Israel

City:
Herzliya
Requirements:
Requirements:
* B.Sc. in Electrical Engineering from a leading university.
* At least 1-2 years of experience in complex ASIC verification.
* Experience in building IP verification environment.
* Experience in UVM methodology.
* Good knowledge in Verilog.
* Experience in embedded C programming – advantage.
* Good communication and interpersonal skills. SolarEdge recognizes its talented and diverse workforce as a key competitive advantage. Our business success is a reflection of the quality and skill of our people. SolarEdge is committed to seeking out and retaining the finest human talent to ensure top business growth and performance
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8159416
סגור
שירות זה פתוח ללקוחות VIP בלבד
סגור
דיווח על תוכן לא הולם או מפלה
מה השם שלך?
תיאור
שליחה
סגור
v נשלח
תודה על שיתוף הפעולה
מודים לך שלקחת חלק בשיפור התוכן שלנו :)
5 ימים
Location: Herzliya
Job Type: Full Time
Nuvoton Israel, a leading supplier of custom SoCs and security hardware solutions for the computing and servers' domain, is seeking an experienced System Validation Engineer to join our multidisciplinary R&D System & Validation group. In this role, you will be responsible for Pre and Post-Silicon validation activities, including developing chip functionality tests, building complex validation environments, and creating automated tests. You will gain deep insights into our products, encompassing both hardware and software aspects, while collaborating closely with various R&D teams.
Responsibilities: - Develop and maintain complex validation environments using Embedded C to test a wide range of chip functions - Create sophisticated automated validation tests by learning and implementing new technologies - Analyze system performance - Collaborate with cross-functional teams to ensure product quality and performance
Requirements:
- B.Sc. in Electronic Engineering / computer Engineering / Computer Science from a leading institute - Strong proficiency in C/C++ programming, minimum 3 years of experience (must) - Experience working with boards, chips, and embedded hardware systems (preferred) - Knowledge of security and cryptography principles (advantage) - Experience with laboratory equipment such as logic analyzers and oscilloscopes (advantage) - Excellent communication and interpersonal skills - Ability to work in a dynamic, fast-paced environment
This position is open to all candidates.
 
Show more...
הגשת מועמדותהגש מועמדות
עדכון קורות החיים לפני שליחה
עדכון קורות החיים לפני שליחה
8126038
סגור
שירות זה פתוח ללקוחות VIP בלבד
משרות שנמחקו